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  FPGA項目實戰系列課程(cheng)－－軟件無線(xian)電應用方向

       理工(gong)科(ke)類大專(zhuan)以上(shang)學歷;喜歡并有志投身于IT事業;具備一(yi)定硬件知識;了(le)解Verilog  HDL硬件描(miao)述(shu)語言(yan)。

        1、培訓過程中，如有部分內容理解不透或消化不好，可免費在以后培訓班中重聽；
        2、培訓結束后免費提供半年的技術支持，充分保證培訓后出效果；
  ;       3、培訓合格學員可享受免費推薦就業機會。

第一篇 軟件無線電系統概述及仿真

1. 軟件無線電系統概述
2. 軟件無線電的三種結構形式
3. SignalTAP II 的設計方法和技巧
4. 邏輯分析儀仿真設計

第二(er)篇(pian) 基于FPGA/CPLD的數據采集(ji)系(xi)統工程應用與(yu)工程課題實訓

1. Nyquist采樣以及可以實現頻譜搬移的帶通采樣（欠采樣）
2. 如何通過帶通采樣實現下變頻
3. 在實時通信系統中如何選取適當的采樣頻率去除混疊信號
 4. 基于FPGA/CPLD的帶通采樣（欠采樣）工程應用(yong)以及工程課題(ti)實訓

第三篇 基于FPGA/CPLD的數字濾波器工程應用與工程課題實訓

1. CIC濾波器算法原理
2. 基于FPGA/CPLD的濾波器工程應用以及工程課題實訓
3. 基于FPGA/CPLD的高斯白噪聲信號工程應用以及工程課題實訓
4. 乘累加結構以及分布式算法的FIR數字濾波器
5. MATLAB如何產生濾波器系數
6. 基于FPGA/CPLD的FIR數字濾波器工程應用以及工程課題實訓
7. 基于FPGA/CPLD的高斯濾波器工(gong)程應用(yong)以及工(gong)程課(ke)題實訓(xun)

第四篇 基于FPGA/CPLD的數字上下變頻工程應用與工程課題實訓

1. 基于FPGA/CPLD的載波NCO產生原理與工程應用
2. 基于FPGA/CPLD的數字上變頻原理與工程應用
3. 基于FPGA/CPLD的數字下變頻原理與工程應用
4. 基于FPGA/CPLD的數字上下變頻工程課題實訓(xun)

第五篇 基于FPGA/CPLD的數字調制解調工程應用與工程課題實訓

1. 數字調制解調的基本原理、設計方法以及影響選擇數字調制方式的因素
2. 基于FPGA/CPLD的BPSK調制解調工程應用
3. 基于FPGA/CPLD的BPSK調制解調工程實驗
4. 基于FPGA/CPLD的ASK調制解調工程應用以及工程課題實訓
5. 基于FPGA/CPLD的PSK調制解調工程應用以及工程課題實訓
6. 基于FPGA/CPLD的MSK調制解調工程應用以及工程課題實訓
7. 基于FPGA/CPLD的GMSK調(diao)制解(jie)調(diao)工(gong)程(cheng)應用以及工(gong)程(cheng)課題實訓

第六篇 基于FPGA/CPLD的單頻正弦信號產生工程應用與工程課題實訓

1. 單頻正弦信號產生工作原理
2. 單頻正弦信號產生工程應用
 3. 單頻正弦(xian)信號產生實(shi)驗(yan)

第七篇 偽隨機m序列產生和高斯白噪聲信號產生工程應用與工程課題實訓

1. 基于FPGA/CPLD的偽隨機m序列產生工程應用與工程課題實訓
2. 基于FPGA/CPLD的高斯白噪聲信號產生工程應用與工程課題實訓
3. 基于FPGA/CPLD的高(gao)斯白(bai)噪聲信(xin)號產生實驗

第八篇 基于FPGA/CPLD的多速率信號處理工程應用與工程課題實訓
1. 多速率信號處理概述以及取樣率變換性質
2. 基于FPGA/CPLD的抽取工程應用以及工程課題實訓
3. 基于FPGA/CPLD的插(cha)值工程應用以及(ji)工程課題實(shi)訓

第九篇 基于FPGA/CPLD的同步技術工程應用與工程課題實訓
1. 基于FPGA/CPLD的載波同步工程應用與工程課題實訓
2. 基于FPGA/CPLD的位（碼元）同步工程應用與工程課題實訓
3. 基于FPGA/CPLD的幀同步工程應用(yong)與工程課題實訓

第十(shi)篇 項(xiang)目實訓 項(xiang)目名稱：基于(yu)BPSK調(diao)制(zhi)解調(diao)的(de)高速數字(zi)化無線通信系統 核心(xin)技(ji)術(shu)：碼NCO、成形濾波(bo)器、載(zai)波(bo)NCO、高斯白噪(zao)聲、數字(zi)下變頻、BPSK調(diao)制(zhi)解調(diao)、CIC濾波(bo)器、載(zai)波(bo)環跟蹤(zong)(科斯塔斯Costas環)、數字(zi)上變頻、高斯濾波(bo)、抽取、插值、低通濾波(bo)。（注：這些核心(xin)技(ji)術(shu)全部是(shi)通過(guo)軟件編(bian)程的(de)方式(shi)實現(xian)）

項目主要內容：
該通(tong)(tong)信(xin)(xin)(xin)系統有兩(liang)部(bu)分(fen)組成，一部(bu)分(fen)為高速數(shu)字(zi)化無線(xian)通(tong)(tong)信(xin)(xin)(xin)發(fa)射(she)機(ji)，一部(bu)分(fen)為高速數(shu)字(zi)化無線(xian)通(tong)(tong)信(xin)(xin)(xin)接(jie)收機(ji)。 在基(ji)于FPGA設計的高速數(shu)字(zi)化無線(xian)通(tong)(tong)信(xin)(xin)(xin)發(fa)射(she)機(ji)中，信(xin)(xin)(xin)源碼經過(guo)低通(tong)(tong)濾(lv)(lv)波(bo)(bo)等變(bian)換(huan)(huan)后進行BPSK調(diao)制(zhi)，然后再通(tong)(tong)過(guo)數(shu)字(zi)上(shang)變(bian)頻將基(ji)帶信(xin)(xin)(xin)號(hao)混頻到中頻信(xin)(xin)(xin)號(hao)，再經過(guo)濾(lv)(lv)波(bo)(bo)后送D/A轉換(huan)(huan)器輸出射(she)頻信(xin)(xin)(xin)號(hao)。以上(shang)這些工作全部(bu)是(shi)在FPGA內通(tong)(tong)過(guo)Verilog編(bian)程實現。